TDA4AEN8K5AAMWRQ1 處理器是 Jacinto? 7 汽車級異構 Arm? 處理器系列的擴展，專為高級駕駛輔助系統(tǒng)（ADAS）應用而設計。該處理器集成了深度學習（DL）、視頻處理、視覺處理及 3D 圖形加速功能，并配備顯示接口和豐富的汽車外設及網(wǎng)絡選項，專為成本和功耗敏感的汽車應用而設計，例如 NCAP 前置攝像頭或入門級泊車輔助系統(tǒng)。

TDA4AEN8K5AAMWRQ1 處理器特性

處理器核心：

最高支持四核 64 位 Arm Cortex-A53 微處理器子系統(tǒng)，主頻最高達 1.4GHz

四核 Cortex-A53 核心集群，配備 512KB L2 共享緩存，支持 SECDED ECC

每個 A53 核心配備 32KB L1 數(shù)據(jù)緩存（帶 SECDED ECC）和 32KB L1 指令緩存（帶奇偶校驗保護）

單核 Arm Cortex-R5F，最高 800MHz，作為 MCU 通道的一部分集成，帶 FFI

32KB 指令緩存、32KB L1 數(shù)據(jù)緩存和 64KB 技術緩存（TCM），所有內(nèi)存均帶 SECDED ECC

512KB SRAM，支持SECDED ECC

單核Arm Cortex-R5F，最高頻率800MHz，集成以支持設備管理

32KB ICache、32KB L1 DCache和64KB TCM，所有內(nèi)存均支持SECDED ECC

單核Arm Cortex-R5F，最高頻率800MHz，集成以支持運行時管理

32KB 指令緩存（ICache）、32KB 一級數(shù)據(jù)緩存（L1 DCache）和 64KB 傳輸緩存（TCM），所有內(nèi)存均支持 SECDED ECC

兩個深度學習加速器（總計最高 4 TOPS），每個加速器包含：

C7x 浮點單元，最高 40 GFLOPS，256 位向量 DSP，最高 1.0GHz

矩陣乘法加速器（MMA），最高2 TOPS（8位），最高1.0GHz

32KB L1 DCache，支持SECDED ECC，以及64KB L1 ICache，支持奇偶校驗保護

2.25MB L2 SRAM，支持SECDED ECC

深度和運動處理加速器（DMPAC）

密集光流（DOF）加速器

立體視差引擎（SDE）加速器

視覺處理加速器（VPAC）帶圖像信號處理器（ISP）和多個視覺輔助加速器：

600 MP/s ISP

支持12位RGB-IR

支持最高16位輸入RAW格式

行支持最高4096

寬動態(tài)范圍（WDR）、鏡頭畸變校正（LDC）、視覺成像子系統(tǒng)（VISS）及多尺度（MSC）支持

輸出顏色格式：8位、12位，以及YUV 4:2:2、YUV 4:2:0、RGB、HSV/HSL

TDA4AEN8K5AAMWRQ1 的應用

前置攝像頭系統(tǒng)

環(huán)視和泊車輔助系統(tǒng)

eMirror/攝像頭后視鏡系統(tǒng)（CMS）

基于雷達和激光雷達的汽車感知系統(tǒng)

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